!C99Shell v. 2.0 [PHP 7 Update] [25.02.2019]!

Software: nginx/1.23.4. PHP/5.6.40-65+ubuntu20.04.1+deb.sury.org+1 

uname -a: Linux foro-restaurado-2 5.15.0-1040-oracle #46-Ubuntu SMP Fri Jul 14 21:47:21 UTC 2023
aarch64 

uid=33(www-data) gid=33(www-data) groups=33(www-data) 

Safe-mode: OFF (not secure)

/usr/src/linux-oracle-headers-5.15.0-1040/include/dt-bindings/reset/   drwxr-xr-x
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/* SPDX-License-Identifier: GPL-2.0 */
/*
 * Copyright (C) 2018 Zodiac Inflight Innovations
 *
 * Author: Andrey Smirnov <[email protected]>
 */

#ifndef DT_BINDING_RESET_IMX8MQ_H
#define DT_BINDING_RESET_IMX8MQ_H

#define IMX8MQ_RESET_A53_CORE_POR_RESET0    0
#define IMX8MQ_RESET_A53_CORE_POR_RESET1    1
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#define IMX8MQ_RESET_SW_NON_SCLR_M4C_RST    18
#define IMX8MQ_RESET_OTG1_PHY_RESET        19
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#define IMX8MQ_RESET_MIPI_DSI_RESET_BYTE_N    21    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_DSI_RESET_N        22    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_DSI_DPI_RESET_N    23    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_DSI_ESC_RESET_N    24    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_DSI_PCLK_RESET_N    25    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIEPHY            26    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIEPHY_PERST        27    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIE_CTRL_APPS_EN        28    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIE_CTRL_APPS_TURNOFF    29    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_HDMI_PHY_APB_RESET        30    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_DISP_RESET            31
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#define IMX8MQ_RESET_VPU_RESET            33    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIEPHY2            34    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIEPHY2_PERST        35    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIE2_CTRL_APPS_EN        36    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_PCIE2_CTRL_APPS_TURNOFF    37    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI1_CORE_RESET    38    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI1_PHY_REF_RESET    39    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI1_ESC_RESET    40    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI2_CORE_RESET    41    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI2_PHY_REF_RESET    42    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_MIPI_CSI2_ESC_RESET    43    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_DDRC1_PRST            44    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_DDRC1_CORE_RESET        45    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_DDRC1_PHY_RESET        46    /* i.MX8MN does NOT support */
#define IMX8MQ_RESET_DDRC2_PRST            47    /* i.MX8MM/i.MX8MN does NOT support */
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#define IMX8MQ_RESET_DDRC2_PHY_RESET        49    /* i.MX8MM/i.MX8MN does NOT support */
#define IMX8MQ_RESET_SW_M4C_RST            50
#define IMX8MQ_RESET_SW_M4P_RST            51
#define IMX8MQ_RESET_M4_ENABLE            52

#define IMX8MQ_RESET_NUM            53

#endif

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